logic-level simulation

基本解释

• [电子、通信与自动控制技术]逻辑模拟

英汉例句

双语例句

• This paper presents design and implementation of the simulation module in a logic-level VHDL simulation system.
  介绍了VHDL逻辑级模拟系统中模拟模块的设计和实现。
• With appropriate tool support, designers could perform execution or simulation and debugging on high-level system models to validate and verify system logic early on.
  有了适当的工具支持，设计人员可以在高层的系统模型上进行执行或模拟，并调试，从而在早期确认并验证系统逻辑。

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专业释义

电子、通信与自动控制技术

• 逻辑模拟